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面试过程 两轮面试，一面技术面，二面HR面。
技术面主要针对简历问，从项目到个人技能，并且会追着问，手撕代码撕了一次，剩下的就是一些基础的verilog、SystemVerilog语法知识了。
HR，面就是聊一聊个人的性格，让我说了一些自己感到骄傲的事、举例说明自己负责任等等。

面试过程中面试官提了哪些问题 面的验证岗，大部分都是芯片验证相关的问题。
1.自我介绍
2.VIP怎么写
3.用verilog写一个I2C接口的pad
4.验证流程
5.验证环境怎么搭
6.写一个driver class基本的结构，手撕代码
7.`uvm_component_utils有什么用
8.`ifndef，`define，`endif有什么用
9.UVM中的factory机制有什么好处
10.有没有用过process
11.run_phase和main_phase的区别
12.寄存器模型的方法（write，mirror等）
13.TLM怎么用
14.覆盖率分类
15.形式验证有哪些，有没有用过formality

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有关面试流程的相关细节问答 你是通过何种渠道获得这次面试机会的？
答:校园招聘

你觉得这次面试的难度如何？
答:难度一般

你对这次面试的整体感觉怎么样？
答:一般

这次面试的结果如何？
答:面试成功但没有去报到